Nie masz uprawnień do wyświetlenia tego obiektu. Aby poprosić o dostęp do niego, wypełnij poniższe pola.
Pleskacz, Witold A. ; Rakowski, Michał
2007, nr 3
artykuł
This paper describes the analysis of the influence of yield loss model parameters on the calculation of the probability of arising shorts between conducting paths in IC’s. The characterization of the standard cell in AMS 0.8 μm CMOS technology is presented as well as obtained probability results and estimations of yield loss by changing values of model parameters.
Instytut Łączności - Państwowy Instytut Badawczy, Warszawa
application/pdf
oai:bc.itl.waw.pl:296
10.26636/jtit.2007.3.840
1509-4553
1899-8852
Journal of Telecommunications and Information Technology
ang
Biblioteka Naukowa Instytutu Łączności
24 lip 2024
28 sty 2010
219
https://bc.itl.waw.pl/publication/339
RDF
OAI-PMH
Styl cytowania: Chicago ISO690
Ta strona wykorzystuje pliki 'cookies'. Więcej informacji Rozumiem